職位描述
Verilog HDLVHDLC++電子設(shè)備制造儀器儀表制造專用設(shè)備制造
崗位內(nèi)容：
1. 設(shè)計和開發(fā)嵌入式系統(tǒng)的軟件：完成FPGA驅(qū)動程序、控制邏輯及應(yīng)用層代碼編寫，確保功能符合產(chǎn)品規(guī)格。?
2. 代碼開發(fā)與優(yōu)化：解決和優(yōu)化系統(tǒng)中的技術(shù)難題
3. 調(diào)試與問題排查：利用示波器、邏輯分析儀等工具，定位并解決軟件運行中的 BUG、硬件交互異常等問題，保障系統(tǒng)穩(wěn)定性與可靠性。?
4.技術(shù)協(xié)作與對接：與硬件工程師配合完成硬件選型、原理圖評審及聯(lián)合調(diào)試，參與需求評審、方案討論，向產(chǎn)品、測試團(tuán)隊輸出技術(shù)文檔與接口說明。?
5. 文檔與版本管理：編寫技術(shù)設(shè)計文檔、用戶手冊、測試用例等，
6.與團(tuán)隊成員合作，確保項目按時交付。
任職要求：
1. 本科以上相關(guān)學(xué)歷，有嵌入式軟件開發(fā)經(jīng)驗3年及以上
2. 熟練掌握?Verilog、C/C++等語言
1. 本科以上相關(guān)學(xué)歷，有嵌入式軟件開發(fā)經(jīng)驗3年及以上
2. 熟練掌握?Verilog、C/C++等語言
3.有FPGA嵌入式開發(fā)經(jīng)驗
4.能夠獨立分析和解決問題 5.能夠出差、抗壓能力強(qiáng)、團(tuán)隊協(xié)作能力強(qiáng)
五險一金、交通補、通訊補、餐補等福利待遇
工作地點
北京大興區(qū)中糧·達(dá)瑞興生命健康產(chǎn)業(yè)園-南門1號樓1層
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