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崗位職責(zé)
1. 系統(tǒng)架構(gòu)設(shè)計(jì)：
- 主導(dǎo)射頻微波功率源系統(tǒng)的FPGA方案設(shè)計(jì)，包括頻率合成（DDS/PLL）、動(dòng)態(tài)幅度控制（ALC）、自動(dòng)頻率跟蹤（AFC）、信號(hào)解調(diào)（如IQ解調(diào)）等核心模塊。
- 構(gòu)建高精度、低噪聲的射頻信號(hào)生成與處理鏈路，滿足復(fù)雜電磁環(huán)境下的性能指標(biāo)。
2. 算法工程化實(shí)現(xiàn)：
- 將射頻控制算法（自動(dòng)電平控制、頻率跟蹤、數(shù)字預(yù)失真DPD等）移植至FPGA平臺(tái)，優(yōu)化資源占用與實(shí)時(shí)性。
- 設(shè)計(jì)高速數(shù)據(jù)采集與處理架構(gòu)（如JESD204B接口、多通道同步技術(shù)）。
3. 團(tuán)隊(duì)建設(shè)與技術(shù)管理：
- 組建并領(lǐng)導(dǎo)FPGA技術(shù)團(tuán)隊(duì)，涵蓋硬件邏輯開(kāi)發(fā)、DSP算法三大方向，制定技術(shù)路線與開(kāi)發(fā)規(guī)范。
- 主導(dǎo)FPGA選型（如Xilinx Zynq、Xilinx RFSoC）、硬件平臺(tái)設(shè)計(jì)評(píng)審及系統(tǒng)集成測(cè)試。
4. 跨學(xué)科協(xié)作：
- 與射頻硬件、微波電路、軟件平臺(tái)團(tuán)隊(duì)深度協(xié)作，解決系統(tǒng)級(jí)干擾、時(shí)序收斂、功耗熱管理等挑戰(zhàn)。
任職要求
1. 硬性條件：
- 碩士及以上學(xué)歷，電子工程、通信工程、微電子等相關(guān)專業(yè)，3年以上FPGA開(kāi)發(fā)經(jīng)驗(yàn)。
- 精通以下技術(shù)：
- 射頻控制系統(tǒng)設(shè)計(jì)（ALC/AFC/AGC）
- 高速數(shù)字上下變頻（DDC/DUC）
- 高速ADC和DAC
- 實(shí)時(shí)閉環(huán)反饋算法（FPGA實(shí)現(xiàn)）
- JESD204B/C、LVDS、SerDes等高速接口
- 射頻微波頻段信號(hào)處理（6GHz以下）
2. 核心能力：
- 熟練使用Vivado/Quartus、Matlab/Simulink（HDL Coder）、System Generator等工具鏈。
- 熟練使用微波儀器（信號(hào)源、頻譜分析儀、高速示波器）；
- 掌握射頻系統(tǒng)關(guān)鍵指標(biāo)（相位噪聲、雜散抑制、動(dòng)態(tài)范圍）的FPGA優(yōu)化方法。
- 有Xilinx Zynq RFSoC或類似射頻集成平臺(tái)開(kāi)發(fā)經(jīng)驗(yàn)者優(yōu)先。
- 有國(guó)防電子、醫(yī)療射頻、半導(dǎo)體測(cè)試設(shè)備開(kāi)發(fā)背景；
3. 團(tuán)隊(duì)管理：
- 具備3人以上技術(shù)團(tuán)隊(duì)領(lǐng)導(dǎo)經(jīng)驗(yàn)，擅長(zhǎng)技術(shù)決策與人才培養(yǎng)。