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1、設(shè)計(jì)和實(shí)現(xiàn)從架構(gòu)定義到RTL設(shè)計(jì)的數(shù)字邏輯電路。
2、與系統(tǒng)架構(gòu)師合作，根據(jù)項(xiàng)目需求定義架構(gòu)和詳細(xì)規(guī)范。
3、創(chuàng)建和優(yōu)化RTL 設(shè)計(jì)，包括用于各種半導(dǎo)體應(yīng)用的數(shù)據(jù)路徑、控制邏輯和接口模塊。
4、進(jìn)行徹底的模擬和功能驗(yàn)證，以確保設(shè)計(jì)的正確性和性能。
5、與綜合和時(shí)序收斂團(tuán)隊(duì)合作，優(yōu)化設(shè)計(jì)性能并滿足項(xiàng)目里程碑。
6、執(zhí)行PPAL（性能、功耗、面積和延遲）權(quán)衡分析。
7、準(zhǔn)備全面的設(shè)計(jì)文檔，包括規(guī)格、設(shè)計(jì)審查和測(cè)試計(jì)劃。
8、與跨職能團(tuán)隊(duì)密切合作，包括物理設(shè)計(jì)工程師、軟件工程師、硬件工程師和驗(yàn)證工程師，以確保將設(shè)計(jì)成功集成到整個(gè)系統(tǒng)中。